Protocol Exercisers & Analyzers

RFFE 协议分析仪和练习器

Model No: PGY-RFFE-EX-PD

RFFE 协议分析仪 (PGY-RFFE-EX-PD) 是一款具有多种功能的协议分析仪,用于捕获和调试主机与受测设计 (DUT) 之间的通信。射频前端控制接口 (RFFE) 串行总线接口正成为控制射频前端设备的首选。前端设备多种多样,如功率放大器 (PA)、低噪声放大器 (LNA)、滤波器、开关、电源管理模块和天线调谐器。它广泛应用于移动设备中。

PGY-RFFE-EX-PD 是领先的仪器,设计和测试工程师可以通过将 PGY-RFFE-EX-PD 配置为主机/从机、生成具有错误注入能力和幅度变化的 RFFE 流量以及解码 RFFE 协议数据包,来测试 RFFE 接口是否符合其规范。

Key Protocols
  • RFFE
  • Free Online Technical SupportFree Online Technical Support
  • Free Software UpdatesFree Software Updates
  • Global Sales SupportGlobal Sales Support
  • Evaluation Units AvailableEvaluation Units Available
  • 关键特性
  • 规格参数
  • 技术库

关键特性

  • 支持 RFFE2.0/2.1 规范
  • 可配置为从机或主机
  • 支持以全速和半速生成不同的 RFFE 流量
  • 错误注入功能,如奇偶校验错误和 ACK/NACK 错误
  • 可变 RFFE 数据速率
  • 同步生成 RFFE 流量并进行总线协议解码
  • 协议解码总线的时序图
  • 协议活动的列表视图
  • 协议解码中的错误分析
  • 支持编写练习器脚本,以组合生成不同数据速率的多个数据帧
  • USB2/3 主机接口
  • 可灵活升级设备以适应不断发展的 RFFE 规范
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多域视图

多域视图在单个 GUI 中提供 RFFE 协议活动的完整视图。用户可以使用 GUI 或脚本轻松设置分析仪以生成 RFFE 流量。用户可以从设置菜单中设置不同的触发条件,以捕获特定事件的协议活动,并解码主从机之间的协议事务。解码结果可以在具有自动关联功能的时序图和协议列表窗口中查看。这种全面的信息视图使其成为行业领先的解决方案,为调试 RFFE 协议活动提供了易于使用的工具。

练习器

PGY-RFFE-EX-PD 支持使用 GUI 和脚本生成 RFFE 流量。用户可以使用 GUI 生成简单的流量来测试 DUT。基于脚本的 GUI 提供了模拟真实世界中完整预期流量(包括错误注入)的灵活性。在此示例脚本中,用户可以生成如下 RFFE 流量:

  • 脚本第 4 行:向 USID 为 5 的从机写入寄存器 (REG Write)
  • 脚本第 5 行:从 USID 为 5 的从机读取寄存器 (REG Read)
  • 脚本第 8 行:向 USID 为 5 的从机写入扩展寄存器 (EXT REG Write)
  • 脚本第 9 行:从 USID 为 5 的从机读取扩展寄存器 (EXT REG Read)

时序图和协议列表视图

时序视图提供带有总线图的 SCLK 和 SDATA 信号图。在数字时序波形上叠加协议位将有助于轻松调试协议解码数据。光标和缩放功能方便在时序图中分析任何时序错误的协议。

协议窗口提供每个状态下的解码数据包信息和所有数据包详情。在协议列表窗口中选择的帧将在时序视图中自动关联,以查看数据包的时序信息。

强大的触发功能

PGY-RFFE-EX-PD 支持自动、简单和高级触发功能。分析仪可以针对任何协议数据包进行触发,例如扩展寄存器写入、扩展寄存器读取等消息。高级触发提供了监控多个触发条件的灵活性,并可以设置多状态触发机。

规格参数

PGY-RFFE SpecificationsFeaturesPGY-RFFE-EX-PD
Exerciser:
Configurable1 Master + 4 Slaves
RFFE Traffic GenerationCustom RFFE Traffic Generation
SCL Frequency32KHz to 52 MHz (45?)
Voltage Drive Level1.2V and 1.8V
SCL duty cycle variation25%, 50% and 75%
SCL and SDA delayUser defined in multiples of 5.2ns
Delay between two messagesUser defined
Error injectionParity error injection
Protocol Analysis:
SupportsRFFE 2.0/2.1 protocol decode
Protocol ViewsTiming Diagram View
Protocol Listing View
Bus-Diagram to display Protocol packets with timing diagram plot
Protocol TriggerAuto (Trigger on any packet)
Simple (Trigger on any user defined RFFE packet)
Advanced (Multi-state & multi-level trigger capability)
Capture DurationContinuous streaming Protocol Data
Protocol Error ReportParity
Host ConnectivityUSB 3.0 / 2.0 interface

I3C Protocol Analyzer and Exerciser Application Notes

I3C Protocol Analyzer (PGY-I3C-EX-PD) is the Protocol Analyzer with multiple features to capture and debug communication between host…

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I3C Protocol Trigger & Decode Software

I3C Protocol Decode Software offers protocol decoding as specified in the I3C specification. PGY-I3C-PD Protocol decode software runs…

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SD/SDIO UHS-II Protocol Analyzer Datasheet

I3C Protocol Analyzer (PGY-I3C-EX-PD) is the Protocol Analyzer with multiple features to capture and debug communication between host…

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STEPg1 Electrical Validation and Protocol Decode Software Datasheet

STEPg1 is a 12Gbps high speed serial link in Intel’s 16th generation core and future products. STEPg1, an…

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Logic Analyzer for Embedded Interfaces Datasheet

The Discovery logic analyzer series, PGY-LA-EMBD has the built-in capability to debug I2C protocol, SPI protocol, UART, and…

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I3C

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